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求職意向

IC驗證工程師/設(shè)計驗證工程師 陜西西安 薪資面議 隨時到崗

教育背景

2020.x -2020x 錘子簡歷大學(xué) 集成電路設(shè)計與集成系統(tǒng)

工作經(jīng)驗

2020.x -2020x 錘子簡歷信息技術(shù)有限公司 錘子簡歷信息技術(shù)有限公司

2020.x -2020x 富士康科技集團(tuán) IC設(shè)計驗證工程師

• 負(fù)責(zé)數(shù)字IP模塊級以及系統(tǒng)級的驗證工作，包括Lint、CDC、STA、RTL Simulation、Post simulati on等； 
• 負(fù)責(zé)ASIC RTL 的修改，完成RTL從ASIC到FPGA的移植； 
• 負(fù)責(zé)FPGA Timing constraint的設(shè)定，進(jìn)行時序分析，實現(xiàn)時序收斂，完成FPGA原型驗證工作；
• 負(fù)責(zé)驗證計劃的制定，測試用例的開發(fā)，覆蓋率的收集與分析；
• 負(fù)責(zé)芯片流片后的相關(guān)測試工作。

自我評價

樂觀上進(jìn)，有很強(qiáng)的團(tuán)隊合作意識，自主學(xué)習(xí)能力強(qiáng)，具有很強(qiáng)的抗壓能力，工作中可以獨當(dāng)一面。